超高速数据采集

超高速数据采集系统即采用超高采样速率对数据进行采集的系统。采样率、分辨率为评价超高速数据采集系统的技术指标。超高速数据采集系统的结构设计主要是设计A/D转换和数据存储两大模块，此外，还应兼顾后续数字信号处理部分。在数据采集系统中,处理流程一般包括滤波、采样、存储和处理四个环节。

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同步多个ADC或高速数据采集卡

时钟信号：前面板上的时钟参考信号或通过PXI 背板提供一个通用的参考时钟。这个共同的时钟参考保证了同步的长期稳定性。

有三种情况:时钟的同步是至关重要的:

1. 在单独的通道上进行数据的获取，时间戳用于测量单个脉冲的时间，并在通道之间进行比较。

2. 记录非常长的记录。(例如，时钟频率的1ppm偏差意味着在106的记录结束时一个采样点偏差)。

3. 连续的多个板流到PC上。如果不相锁，数据速率会有所不同。

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数据采集卡应用于工业现场哪些地方

数据采集卡在应用时，数据采集系统置于被监控的设备处，通过传感器对设备的电压或者电流信号进行采样、保持，并送入AD转换器变成数字信号，然后将该信号送到FIFO中。当FIFO中存放的数据到了一定数目时，由ARM7从FIFO中读出，然后通过ARM7的以太网接口或者RS232送给上位机。考虑到要监控的设备可能会很多，所以设计了多路采集通道，他们经过模拟开关后再进入AD转换器。CPLD是整个系统的控制核心，他控制采集通道的切换、AD转换器的启停、转换后的数据在FIFO中的存放地址发生器、产生中断请求以通知ARM7读取存放在FIFO中的数据等。 运行时的数据并送给PC机，通过运行在PC机上的特定软件对这些数据进行分析，以此判断当前运行设备的状况，进而采取相应措施。当前常用的数据采集装置，在其系统软件设计中，多采用单任务顺序机制。这样就存在系统安全性差的问题。这对于稳定性、实时性要求很高的数据采集装置来说是不允许的，因此有必要引入嵌入式操作系统。

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