PCB线路设计

对于线宽线距，以及开路短路等，是厂家***常见的，抛开特殊的不说，一些比较常规的板子，线宽线距当然越大越好，有些文件，一条本来可以走得直直的走线，偏偏中间非要出现几个弯，同排好几根宽大小相同走线，间距不一样，比如有些地方间距才0.10MM，有些地方则有0.20MM，在布线时，就要注意这些细节方面；还有一些线路焊盘或者走线与大铜皮的距离只有0.127MM，增加了厂家处理菲林的难度，焊盘走线与大铜皮的距离有0.25MM以上；有些走线则距外围或V-CUT处的安全距离很小，厂家能够移还好，有些则必须一定要设计好才能做，甚至有不是同一个网络的走线连在一起，而有些明明是同一个网络的，偏偏又没连，就发现是短路开路，然后要重新修改资料，这种情况还不在少数，有经验的工程师或许可以看得出，经验不足的则只跟着设计的文件做，结果是要么修改文件重新打样或者用刀片刮开或者飞线，对于线路有阻抗要求的板，***后也是不符合要求。另外有些板的过孔设计在***D PAD上，焊接时则漏锡下去。

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如何处理PCB布线中的一些冲突问题

晶振是模拟的正反馈振荡电路, 要有稳定的振荡信号, 必须满足loop gain 与 phase 的规范, 而这模拟信号的振荡规范很容易受到干扰, 即使加 ground guard traces 可能也无法完全隔离干扰。而且离的太远,地平面上的噪声也会影响正反馈振荡电路。 所以, 一定要将晶振和芯片的距离进可能靠近。

确实高速布线与 EMI 的要求有很多冲突。但基本原则是因 EMI 所加的电阻电容或 ferrite bead, 不能造成信号的一些电气特性不符合规范。 所以, 先用安排走线和 PCB 迭层的技巧来解决或减少 EMI的问题, 如高速信号走内层。***后才用电阻电容或 ferrite bead 的方式, 以降低对信号的伤害。

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如何解决高速信号的手工布线和自动布线之间的矛盾?

现在较强的布线软件的自动布线器大部分都有设定约束条件来控制绕线方式及过孔数目。各家 EDA公司的绕线引擎能力和约束条件的设定项目有时相差甚远。 例如, 是否有足够的约束条件控制蛇行线(serpentine)蜿蜒的方式, 能否控制差分对的走线间距等。 这会影响到自动布线出来的走线方式是否能符合设计者的想法。 另外, 手动调整布线的难易也与绕线引擎的能力有关系。 例如, 走线的推挤能力,过孔的推挤能力, 甚至走线对敷铜的推挤能力等等。 所以, 选择一个绕线引擎能力强的布线器, 才是解决之道。

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