DIP封装（Dual In-line Package），也叫双列直插式封装技术，指采用双列直插形式封装的集成电路芯片，绝大多数中小规模集成电路均采用这种封装形式，其引脚数一般不超过100。DIP封装的CPU芯片有两排引脚，需要插入到具有DIP结构的芯片插座上。

表面贴装技术***T

表面安装技术，英文称之为“Surface Mount Technology”，简称***T，它是将表面贴装元器件贴、焊到印制电路板表面规***置上的电路装联技术，所用的负责制电路板无无原则钻孔。具体地说，就是首先在印制板电路盘上涂布焊锡膏，再将表面贴装元器件准确地放到涂有焊锡膏的焊盘上，通过加热印制电路板直至焊锡膏熔化，冷却后便实现了元器与印制板之间的互联。20世纪80年代，***T生产技术日趋完善，用于表面安装技术的元器件大量生产，价格大幅度下降，各种技术性能好，价格低的设备纷纷面世，用***T组装的电子产品具有体积小，性能好、功能全、价位低的优势，故***T作为新一代电子装联技术，被广泛地应用于航空、航天、通信、计算机、汽车、办公自动化、家用电器等各个领域的电子产品装联中。

一、DIP后焊不良-短路

特点：在不同线路上两个或两个以上之相邻焊点间，其焊垫上之焊锡产生相连现象。

允收标准：无此现象即为允收，若发现即需二次补焊。

影响性：严重影响电气特性，并造成零件严重损害。

1，短路造成原因：

1）板面预热温度不足。

2）输送带速度过快，***T贴片加工价格，润焊时间不足。

3）助焊剂活化不足。

4）板面吃锡高度过高。

5）锡波表面氧化物过多。

6）零件间距过近。

7）板面过炉方向和锡波方向不配合。

昨天在知乎里面提了个问题“电子元器件存放多久后需要重新评估焊锡性，有没有标准定义？”，一天下来发现大家其实针对这个问题都没有好好的研究过，所以今天在这里好好的跟大家讨论讨论关于电子元器件在运输与存储方面的一些标准，以及标准要求。

首先，我们先聊一下研究这个问题的背景，前不久我的一位从事供应商质量管理的朋友碰到了个麻烦事情，他们***T在打板时发现有一个批次的MOSFET发生大批量拒焊问题，所以判定为零件长期未使用造成了元器件的焊锡性失效，但问题是制造商并没有将相应MOS的保质期写在零件的规格书中，所以导致这位SQE也没办法判定，是否为真的过期导致。

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