数字IC设计流程1、需求分析与规格制定对市场调研，弄清需要什么样功能的芯片。芯片规格，也就像功能列表一样，是客户向芯片设计公司提出的设计要求，包括芯片需要达到的具体功能和性能方面的要求。2、架构设计与算法设计根据客户提出的规格要求，对一些功能进行算法设计，拿出设计解决方案和具体实现架构，划分模块功能。3、HDL编码使用硬件描述语言（VHDL，VerilogHDL）分模块以代码来描述实现，RTLcoding，linux环境下一般用Gvim作为代码编辑器。4、功能验证就是检验编码设计的正确性。不符合规格要重新设计和编码。设计和验证是反复迭代的过程，直到验证结果显示完全符合规格标准。该部分称为前。5、逻辑综合――DesignCompiler验证通过，进行逻辑综合。逻辑综合就是把HDL代码翻译成门级网表netlist。综合需要设定约束条件，就是你希望综合出来的电路在面积，时序等目标参数上达到的标准。逻辑综合需要基于特定的综合库，不同的库中，门电路基本标准单元（standardcell）的面积，时序参数是不一样的。所以，综合库不一样，综合出来的电路在时序，面积上是有差异的。一般来说，综合完成后需要再次做验证（这个也称为后）逻辑综合工具：Synopsys的DesignCompiler，工具选择上面的三种工具均可。6、静态时序分析——STAStaticTimingAnalysis（STA），静态时序分析，验证范畴，它主要是在时序上对电路进行验证，检查电路是否存在建立时间（setuptime）和保持时间（holdtime）的违例（violation）。这个是数字电路基础知识，一个寄存器出现这两个时序违例时，是没有办法正确采样数据和输出数据的，所以以寄存器为基础的数字芯片功能肯定会出现问题。数IC设计产品类型？对于当今所有的IC设计，DCUltra是可以利用的的综合平台。它扩展了DCExpert的功能，包括许多的综合优化算法，让关键路径的分析和优化在的时间内完成。在其中集成的ModuleCompiler数据通路综合技术，DCUltra利用同样的VHDL/Verilog流程，能够创造处又快又小的电路。DFTCompilerDFTCompiler提供独创的“一遍测试综合”技术和方案。它和DesignCompiler、PhysicalCompiler系列产品集成在一起的，包含功能强大的扫描式可测性设计分析、综合和验证技术。DFTCompiler可以使设计者在设计流程的前期，很快而且方便的实现高质量的测试分析，确保时序要求和测试覆盖率要求同时得到满足。DFTCompiler同时支持RTL级、门级的扫描测试设计规则的检查，以及给予约束的扫描链插入和优化，同时进行失效覆盖的分析。PowerCompilerPowerCompiler?提供简便的功耗优化能力，能够自动将设计的功耗化，提供综合前的功耗预估能力，让设计者可以更好的规划功耗分布，在短时间内完成低功耗设计。PowerCompiler嵌入DesignCompiler/PhysicalCompiler之上，是业界可以同时优化时序、功耗和面积的综合工具。FPGACompilerIIFPGACompilerII是一个专用于快速开发高品质FPGA产品的逻辑综合工具，可以根据设计者的约束条件，针对特定的FPGA结构（物理结构）在性能与面积方面对设计进行优化，自动地完成电路的逻辑实现过程，从而大大降低了FPGA设计的复杂度。IC什么怎么设计的？在IC生产流程中，IC多由***IC设计公司进行规划、设计，像是联发科、高通、Intel等大厂，都自行设计各自的IC芯片，提供不同规格、效能的芯片给下游厂商选择。因为IC是由各厂自行设计，所以IC设计十分仰赖工程师的技术，工程师的素质影响着一间企业的价值。然而，工程师们在设计一颗IC芯片时，究竟有那些步骤？设计流程可以简单分成如下。设计步，订定目标在IC设计中，的步骤就是规格制定。这个步骤就像是在设计建筑前，先决定要几间房间、浴室，有什么建筑***需要遵守，在确定好所有的功能之后在进行设计，这样才不用再花额外的时间进行后续修改。IC设计也需要经过类似的步骤，才能确保设计出来的芯片不会有任何差错。规格制定的步便是确定IC的目的、效能为何，对大方向做设定。接着是察看有哪些协议要符合，像无线网卡的芯片就需要符合IEEE802.11等规范，不然，这芯片将无法和市面上的产品兼容，使它无法和其他设备联机。后则是确立这颗IC的实作方法，将不同功能分配成不同的单元，并确立不同单元间链接的方法，如此便完成规格的制定。设计完规格后，接着就是设计芯片的细节了。这个步骤就像初步记下建筑的规画，将整体轮廓描绘出来，方便后续制图。在IC芯片中，便是使用硬件描述语言（HDL）将电路描写出来。常使用的HDL有Verilog、VHDL等，藉由程序代码便可轻易地将一颗IC地菜单达出来。接着就是检查程序功能的正确性并持续修改，直到它满足期望的功能为止。▲32bits加法器的Verilog范例。有了计算机，事情都变得容易有了完整规画后，接下来便是画出平面的设计蓝图。在IC设计中，逻辑合成这个步骤便是将确定无误的HDLcode，放入电子设计自动化工具（EDAtool），让计算机将HDLcode转换成逻辑电路，产生如下的电路图。之后，反复的确定此逻辑闸设计图是否符合规格并修改，直到功能正确为止。)